Diseño e implementación del modelador para un simulador de eventos discretos basado en análisis RAM con el cálculo de disponibilidad y paralelización del algoritmo del simulador (MainTUNER Fase 4)

dc.contributor.advisorOvalle Martínez, Diana Marcelaspa
dc.contributor.advisorGranada Jiménez, Jorge Edisonspa
dc.contributor.authorMartínez Duarte, Cristian Fernandospa
dc.contributor.authorPeña Ortiz, David Fernandospa
dc.date.accessioned2019-04-29T14:31:16Z
dc.date.available2019-04-29T14:31:16Z
dc.date.created2019-02-27spa
dc.descriptionEn este documento se muestran los resultados obtenidos en la realización de una interfaz gráfica y el algoritmo para cálculo de disponibilidad de sistemas industriales con la implementación de computo paralelo para el algoritmo de sintonización de mantenimientos para sistemas industriales.spa
dc.description.abstractThis document shows the results obtained in the realization of a graphical interface and the algorithm for calculation of availability of industrial systems with the implementation of parallel computation for the maintenance tuning algorithm for industrial systems.spa
dc.description.sponsorshipKnar S.A.S.spa
dc.format.mimetypepdfspa
dc.identifier.urihttp://hdl.handle.net/11349/14812
dc.language.isospaspa
dc.rightsAtribución-NoComercial-SinDerivadas 4.0 Internacional*
dc.rights.accesoAbierto (Texto Completo)spa
dc.rights.accessrightsinfo:eu-repo/semantics/openAccessspa
dc.rights.urihttp://creativecommons.org/licenses/by-nc-nd/4.0/*
dc.subjectModeladorspa
dc.subjectAnálisis RAMspa
dc.subjectMain tuner fase 4spa
dc.subject.keywordModelerspa
dc.subject.keywordRAM analysisspa
dc.subject.keywordMain tuner phase 4spa
dc.subject.lembIngeniería Electrónica - Tesis y disertaciones académicasspa
dc.subject.lembAlgoritmos (Computadores)spa
dc.subject.lembAnálisis RAMspa
dc.subject.lembControl de procesos industrialesspa
dc.titleDiseño e implementación del modelador para un simulador de eventos discretos basado en análisis RAM con el cálculo de disponibilidad y paralelización del algoritmo del simulador (MainTUNER Fase 4)spa
dc.title.titleenglishDesign and implementation of the modeler for a discrete event simulator based on RAM analysis with the calculation of availability and parallelization of the simulator algorithm (Main Tuner phase 4)spa
dc.type.coarhttp://purl.org/coar/resource_type/c_7a1fspa
dc.type.degreePasantíaspa
dc.type.driverinfo:eu-repo/semantics/bachelorThesisspa

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